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74HC4051D DIP16

The 74HC4051; 74HCT4051 is a high-speed Si-gate CMOS device and is pin compatible with Low-power Schottky TTL (LSTTL). The device is specified in compliance with JEDEC standard no. 7A. The 74HC4051; 7
DIP16

产品实拍图

本型号暂无已核对的专属实拍图。为避免图文不符,本页不放同系列近似图;如需实物照片,请联系销售获取本批次实拍。

产品应用与封装尺寸

图纸取自原厂规格书,点击可放大查看原始尺寸标注。

引脚定义与内部结构

引脚符号名称
8X
9S2
10S1
11S0
12Y3
13Y0
14Y1
15Y2
16VCC
数据来源:原厂规格书引脚图

产品特点 Features

  •  Wide analog input voltage range from 5 V to +5 V
  •  Low ON resistance:
  •  80  (typical) at V  V = 4.5 V
  • CC EE
  •  70  (typical) at V  V = 6.0 V
  •  60  (typical) at V  V = 9.0 V
  •  Logic level translation: to enable 5 V logic to communicate with 5 V analog signals
  •  Typical ‘break before make’ built-in
  •  ESD protection:
  • 74HC4051; 74HCT4051
  • 8-channel analog multiplexer/demultiplexer
  • S0 Y1
  • 11 14 MUX/DMUX
  • S1 Y2 0
  • 10 15
  • S2 Y3

绝对最大额定值 Absolute Maximum Ratings(TA = 25°C)

超过下表数值可能造成器件永久损坏,设计时请留余量。

damagetothe器件Limiting值arestress额定值onlyand(proper)
operationofthedeviceat theseor anyotherconditionsabovethosegiven in
数据来源:原厂规格书

相关 / 可替代型号

以上型号来自规格书与型号命名比对,参数需以各自规格书为准;下单前请与销售确认封装与脚位。

订货信息与供货形式

型号型号2封装
Table1.Ordering info rmation
TypenumberPackage
fromVEEZ

应用领域 Applications

Product data sheet.74HC4051; 74HCT405117. Contact information18. Contents

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营业时间:周一至周六 9:30 — 18:00
深圳市福田区华强北飞亚达大厦西座五楼501
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